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更新時間:2025.04.12
基于SDR的DPSK調(diào)制解調(diào)器設(shè)計

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本文研究了基于SDR的DPSK調(diào)制解調(diào)器的實現(xiàn)方法,對DPSK調(diào)制與解調(diào)中的重難點進(jìn)行了研究。并通過SDR開發(fā)平臺實現(xiàn)了對音頻信號在8K采樣率下的調(diào)制與解調(diào)。仿真結(jié)果表明基本達(dá)到了設(shè)計要求。

基于FPGA的0-QPSK調(diào)制解調(diào)器設(shè)計

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利用QuartusII和ModelSim軟件,基于EP2C35芯片F(xiàn)PGA開發(fā)平臺,通過Verilog-HDI。語言,完成了O-QPSK調(diào)制解調(diào)器的設(shè)計。該設(shè)計具有結(jié)構(gòu)簡單、占用芯片面積少、便于生成IP核等優(yōu)點。電路與系統(tǒng)的仿真結(jié)果表明,所預(yù)期的功能均已實現(xiàn),該方法適合在無線傳感器網(wǎng)絡(luò)及低功耗通信集成電路設(shè)計中應(yīng)用。

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