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更新時間:2025.04.26
基于數(shù)據(jù)選擇器和D觸發(fā)器的多輸入時序電路設(shè)計

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頁數(shù): 3頁

為了探索多輸入時序邏輯電路的簡便實現(xiàn)方法,介紹了基于數(shù)據(jù)選擇器和D觸發(fā)器的多輸入時序邏輯電路設(shè)計技術(shù)。即將D觸發(fā)器和數(shù)據(jù)選擇器進(jìn)行組合,用觸發(fā)器的現(xiàn)態(tài)作為數(shù)據(jù)選擇器選擇輸入變量、數(shù)據(jù)選擇器的輸出函數(shù)作為觸發(fā)器的D輸入信號,構(gòu)成既有存儲功能又有數(shù)據(jù)選擇功能的多輸入端時序網(wǎng)絡(luò)。由觸發(fā)器的現(xiàn)態(tài)選擇輸入變量、所選擇的輸入變量決定觸發(fā)器的次態(tài)轉(zhuǎn)換方向。該方法適合實現(xiàn)互斥多變量時序邏輯電路,且在設(shè)計過程中不需要進(jìn)行函數(shù)化簡。

一種抗單粒子全加固D觸發(fā)器的設(shè)計

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采用當(dāng)前成熟的兩種抗單粒子翻轉(zhuǎn)鎖存器構(gòu)成了主從D觸發(fā)器,在D觸發(fā)器加固設(shè)計中引入了時鐘加固技術(shù),對輸出也采用了加固設(shè)計。仿真對比顯示本設(shè)計的加固效果優(yōu)于國內(nèi)同類設(shè)計。

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